Gateway设计自动化

Gateway设计自动化（英語：）公司，最初名为自动化集成设计系统（）公司，是一个致力于电子设计自动化的企业，该公司于1985年改为现名。最初，公司由Prabhu Goel博士持有，他是PODEM测试生成算法的发明者。[1] Verilog硬件描述语言则由菲尔·莫比（）设计[2]，他后来成为了Verilog-XL的首席设计师，并成为了Cadence Design Systems的首批合伙人。凭借着Verilog-XL的成功，Gateway设计自动化迅猛发展，后来它于1989年被位于加利福尼亚州圣迭戈的Cadence公司收购。[3]

相关条目

参考文献
  1. Goel's role in PODEM invention briefly described in Alberto Sangiovanni-Vincentelli. (November-December 2003) The Tides of EDA. IEEE Design and Test of Computers. p.62. Viewed 20 September 2006 at UC Berkeley web site （页面存档备份，存于）.
  2. Design Automation Conference. (2006). Awards (pdf).DAC web site （页面存档备份，存于） p. 2
  3. Verilog.com （页面存档备份，存于） viewed 20 September 2006.
This article is issued from Wikipedia. The text is licensed under Creative Commons - Attribution - Sharealike. Additional terms may apply for the media files.